uvm中tlm一個細節問題 (not factory)

普通組件我們一般用 factory機制進行構造。方法如下： B = A::type_id::create("B",this) 但是對於TLM端口，並沒有factory機制的支持。因此必須調用內在的父類的構造方法。 那怎麼辦，先看一下uvm_analysis_port的內容。 查閱資料uvm_tlm_if_base這個類聲明瞭TLM API的所有方法。而uvm_port_base是生成處理TLC之間

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