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用可編程邏輯器件FPGA實現組合邏輯電路設計
時間 2020-12-31
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FPGA
組合邏輯
數電
Quartus
加減運算電路
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「數電」實驗報告 第3次 2018 年 06月06日 「用可編程邏輯器件FPGA實現組合邏輯電路設計」實驗報告 一. 實驗目的 1.掌握中規模數字集成器件的邏輯功能及使用方法 2.熟悉組合邏輯電路的設計方法 3.瞭解數字可編程器件的應用設計 4.學會QUARTUS軟件的基本使用方法 二. 實驗器材 軟件:QUARTUSII 硬件:DE-2實驗板,PC機 三. 實驗任務及要求 1. 設計
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