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僞差IO分標準
時間 2020-12-30
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僞差分電平 所謂僞差分電平,就是信號在接收端是一個差分的接收器,但其中一端固定接參考電壓,而另一端接單端信號線。輸入信號電壓與參考電壓之間進行比較,作爲判斷輸入信號高低的標準。 常用的僞差分電平標準有SSTL、HSTL等。如下圖所示爲HSTL信號電平連接關係圖,其中分爲CLASSI和CLASS II 。 僞差分標準的輸出驅動器也是推輓式的結構(push-pull),而輸入是差分的接收器,其中有一端
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