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TTL三態輸出與非門
時間 2021-05-16
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電路如下,當 E N ‾ \overline{EN} EN=0時,EN=1,Y= A B ‾ \overline{AB} AB;當 E N ‾ \overline{EN} EN=1時,EN=0, T 4 T_4 T4、 D 3 D_3 D3、 T 5 T_5 T5均處於截止狀態,Y=Z。
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