ZYNQ隨筆——AXI4總線

1. AXI4通道
讀地址通道(Read address channel, AR)
寫地址通道(Write address channel, AW)
讀數據通道(Read data channel, R)
寫數據通道(Write data channel, W)
寫響應通道(Write response channel, B)
每一個通道由一個信號構成,而且使用雙向的VALID和READY握手信號機制。
2. AXI4信號定義
ZYNQ隨筆——AXI4總線
3. AXI4讀寫波形
AXI4突發寫波形,以下圖所示。
ZYNQ隨筆——AXI4總線
AXI4讀突發波形,以下圖所示。
ZYNQ隨筆——AXI4總線
4. AXI4-Lite
AXI4-Lite接口是AXI4接口的子集,規模較小,有以下特色:ide

  • 全部交易的突發長度爲1
  • 全部訪問數據的寬度相同
  • 只支持32位或64位訪問
  • 全部訪問AWCACHE和ARCACHE等於0
  • 不支持互斥操做
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