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Vivado將模塊封裝爲IP的方法(網表文件)
時間 2020-12-20
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FPGA Vivado 封裝ip 網表
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在給別人用自己的工程時可以封裝IP,Vivado用封裝IP的工具,可以得到像xilinx的ip一樣的可以配置參數的IP核,但是用其他工程調用後發現還是能看到源文件,如何將工程源文件加密,暫時沒有找到方法,如果知道還請賜教。而直接用.edif網表文件作爲ip的方法如下: 1、建立工程設置頂層模塊 將需要封裝的模塊設置爲頂層模塊。(shift_bus模塊) 2、綜合待封裝模塊 vivado綜合時會默認
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