FPGA series # block design 的 error
add module出現的error： unable to resolve module-source based on inputs 無法根據輸入解析模塊源 解決方法： 這裏解釋一下，紅色標記的部分原本是有個小黃塊的，error的出現就是因爲那個小黃塊，此操作正是爲了消除小黃塊。由於前期忘記截圖，所以手動補上。以後要把截圖作爲一個記錄的小習慣，後期總結用得上。 這裏原來調用IP核時選擇的是out
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