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單脈衝採樣(1)---慢時鐘採樣快時鐘
時間 2021-01-18
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跨時鐘域
脈衝採樣
verilog
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pulse_sample 適用場景 適用於脈衝信號採樣,慢時鐘採樣快時鐘 基本原理 將快時鐘域的脈衝信號擴展成多週期的電平信號,慢時鐘同步電平信號進行採樣得到同步後的電平信號,此時通過電平延時組合邏輯由電平產生脈衝信號。 限制 快時鐘域的兩次脈衝應該應該有一定的間隔,否則擴展後的電平信號連在一起了,會導致同步後的信號只有一個脈衝 說明 源時鐘域src_pulse依次輸入給src_pulse_seq
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