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【JokerのZYNQ7020】UART
時間 2021-01-11
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軟件環境:vivado 2017.4 硬件平臺:XC7Z020 內部結構大概如圖所示,PL這邊跟上節中斷配置的基本一樣,其實主要還是在SDK程序這邊。 Vivado 2017.4 Create Block Design後,添加ZYNQ7 Processing system,然後自動連接就行,Generate the output products,Create a HDL wrap
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