一張圖說明三極管開關電路基極爲什麼要加下拉電阻！
1. 當上一級IO口輸出爲PN結構造的晶體管時才考慮 2. 當上一級IO口爲MOS管結構時，無需考慮，別JB在這裏說高阻抗抗干擾，對於三極管輸入來說，有狗屁的高阻抗，說高阻抗的自己好好動動豬腦子 3. 看不懂上圖的人可以留言，不懂不要緊，別瞎JB亂蒙
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