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基於FPGA的跨時鐘域信號處理——專用握手信號
時間 2021-01-03
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在邏輯設計領域,只涉及單個時鐘域的設計並不多。尤其對於一些複雜的應用,FPGA往往需要和多個時鐘域的信號進行通信。異步時鐘域所涉及的兩個時鐘之間可能存在相位差,也可能沒有任何頻率關係,即通常所說的不同頻不同相。 本文引用地址:http://www.eepw.com.cn/article/269611.htm 圖1是一個跨時鐘域的異步通信實例,發送域和接收域的時鐘分別是clk_a和clk_b。這
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