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FPGA 脈動陣列的設計
時間 2021-01-17
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一:定義 脈動陣列:數據流同步流過相鄰的二維陣列單元的處理器結構,一般不同方向流過不同數據。如下圖: 二維不同數據在同一時鐘下依次輸入每個處理單元,而後完成乘法並存在其寄存器中。 二:舉例 三:設計 結構: 單個PE的代碼 module pe(clk, reset, coeff, in_x, in_y, out_x, out_y); parameter size = 8; input???????
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