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quartusⅡ9.1波形仿真
時間 2020-12-27
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quartus9.1 quartus FPGA VHDL HDL
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1.首先需要先編譯成功 2.新建VMF文件 創建成功後如下: 3.添加輸入端口和輸出端口 雙擊虛線框 點擊Node Finder 完成後: 點擊兩次OK後即可: 這時候可以選擇輸入端口進行輸入波形的選擇(左側欄),例如時鐘信號,全0或全1信號,隨機信號等等。 4.進行仿真 選擇process->simulator tool 成功觀察波形即可。
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