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計算機系統實驗:總線實驗
時間 2020-12-28
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2019年3月6日 活動:總線實驗 解釋:3月5日時我同時寫了VHDL和dbf文件兩種格式,發現通過vhdl可以很輕鬆的實現總線要求的所有操作,同時可以很輕鬆的完成實驗要求的r1和r2寄存器的交換操作,但是。在通過dbf格式實現總線實驗的時候出了一些狀況,不知道爲什麼我和我的組員的現象不一致,他沒有le~result這個輸出而我有,而且我的總線怎麼也沒有輸出,不知道爲什麼。推測是因爲對三態門那個芯
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