ISE工程建立(含IP核建立)和chipscope實驗
可進qq羣進行相關Verilog知識交流：1073030956 一個完整工程的建立 打開軟件，點擊file——new project。 2. 建立一個新的工程，工程名爲project1_produce_1M-15MHz_Sin_wave_use_chipscope_simulation，next~。 根據自己使用的板子類型，設置下列參數並點擊next– 這裏是總結界面 3. 添加source，右鍵
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