PCIe簡介及引腳定義

參考文章：http://www.2cto.com/os/201607/523581.html http://blog.csdn.net/michaelcao1980/article/details/42778405 隨着現代處理器技術的發展，在互連領域中，使用高速差分總線替代並行總線是大勢所趨。與單端並行信號相比，高速差分信號可以使用更高的時鐘頻率，從而使用更少的信號線，完成之前需要許多單端並行數

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